「特惠周倒计时仅剩1天」IC前端、后端设计专场，75折特价

踏青周EETOP创芯大讲堂特别活动

创芯大讲堂经常收到同学们的就业咨询，希望能够学习成套的课程，有利于岗位项目的方便上手。所以4月2日至4月8日创芯大讲堂推出数字前端、后端课程优惠合辑。

课程包括：《Verilog基础及典型数字电路设计》《数字后端设计流程》《数字后端设计流程工艺库资料》三门课，原价698元，现在只需7.5折价格！

(注：分别购买每门课程，也会有75折特惠。机会难得，建议打包一起购买！）

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（注：想免费进行锁相环相关试听课程学员也可以直接添加此微信进行课程试听）

Verilog基础及典型数字电路设计

课程介绍

课程中首先会给大家讲解在企业中一般数字电路从算法到流片这整个过程中会涉及到哪些流程，都分别使用什么工具，以及其中每个流程都分别做了什么，是如何操作的，为什么需要这个流程。其次课程后续的内容会分为两大部分：一部分是基础知识的讲解，包括Verilog HDL的基础及语法，各种可综合的代码风格、应用到验证环境中的代码、常见数字电路通路的设计。另一部分是在大家掌握了基本的Verilog HDL基础后，进行实际上机操作，培训大家完成一些常见的数字电路设计，学会如何写一些实际的数字电路模块，以及如何使用EDA工具进行仿真，有问题了之后如何使用EDA工具进行Debug。

Verilog课程购买

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数字后端设计流程课程购买

课程概述

课程简介：本课程主要讲解了数字后端设计的全流程，本人从事该方面研究多年，经验丰富，经过多次流片验证，主要基于smic55nm工艺，包括理论授课，脚本学习与编写，实战作业，具有很强的系统性。

课程涵盖相关课件PPT，但此价位课程不包含派发脚本数据资料。

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数字后端设计流程工艺库资料

重要提示：

本课程为创芯大讲堂另一节课程《数字后端设计流程》课程的资料汇总部分（不是视频）包括：脚本及工艺库。

本课程为资料课程，不涉及视频讲解。您可以先购买EETOP创芯大讲堂的《数字后端设计流程》课程的，再进行本课的资料学习。

所有参考资料请您用电脑打开第一课时，可以看到左下角的参考资料，在此获取。

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